如何降低噪音和電磁干擾
2014-10-11
降低噪聲與電磁干擾的一些經驗。
(1) 能用低速芯片就不用高速的，高速芯片用在關鍵地方。
(2) 可用串一個電阻的辦法，降低控制電路上下沿跳變速率。
(3) 盡量為繼電器等提供某種形式的阻尼。
(4) 使用滿足系統(tǒng)要求的最低頻率時鐘。
(5) 時鐘產生器盡量靠近到用該時鐘的器件。石英晶體振蕩器外殼要接地。
(6) 用地線將時鐘區(qū)圈起來，時鐘線盡量短。
(7) I/O驅動電路盡量靠近印刷板邊，讓其盡快離開印刷板。對進入印制板的信號要加濾波，從高噪聲區(qū)來的信號也要加濾波，同時用串終端電阻的辦法，減小信號反射。
(8) MCD無用端要接高，或接地，或定義成輸出端，集成電路上該接電源地的端都要接，不要懸空。
(9) 閑置不用的門電路輸入端不要懸空，閑置不用的運放正輸入端接地，負輸入端接輸出端。
(10) 印制板盡量使用45折線而不用90折線布線以減小高頻信號對外的發(fā)射與耦合。
(11) 印制板按頻率和電流開關特性分區(qū)，噪聲元件與非噪聲元件要距離再遠一些。
(12) 單面板和雙面板用單點接電源和單點接地、電源線、地線盡量粗，經濟是能承受的話用多層板以減小電源，地的容生電感。
(13) 時鐘、總線、片選信號要遠離I/O線和接插件。
(14) 模擬電壓輸入線、參考電壓端要盡量遠離數(shù)字電路信號線，特別是時鐘。
(15) 對A/D類器件，數(shù)字部分與模擬部分寧可統(tǒng)一下也不要交叉。
(16) 時鐘線垂直于I/O線比平行I/O線干擾小，時鐘元件引腳遠離I/O電纜。
(17) 元件引腳盡量短，去耦電容引腳盡量短。
(18) 關鍵的線要盡量粗，并在兩邊加上保護地。高速線要短要直。
(19) 對噪聲敏感的線不要與大電流，高速開關線平行。
最新資訊
